AMD2015校园招聘求职大礼包

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全文目录

第一章 AMD简介    3
1.1 AMD概况    3
1.2 AMD业务发展    3
1.3 AMD的产品系列    3
1.4 AMD在中国    4
1.5 AMD发展历史    5
1.6 AMD高级管理人员简历    9

第二章 AMD笔试资料    10
2.1 AMD CPU ASIC design engineering笔试题    10
2.2 AMD笔试题    11
2.3 AMD北京分公司笔经    11
2.4 AMD笔试真题及答案    12
2.5 AMD新鲜笔经    15
2.6 AMD笔试题    15
2.7 AMD北京笔试经历    15

第三章 AMD面试资料    16
3.1今天上午刚面完AMD（上海）    16
3.2 AMD面试杯具    16
3.3 AMD两面    17
3.4 AMD面试总结    18
3.5 AMD公司面经    19
3.6 AMD一面面经    19
3.7 AMD二面    20
3.8 AMD面经    20
3.9 AMD面试题    21

第四章 AMD综合求职经验    21
4.1历届AMD 应届毕业生薪资    21
4.2我在SRDC的GPG部门    21
4.3 AMD工作感受    23
4.4留在AMD的理由    23
4.5 AMD的工作感受    24

附录：更多求职精华资料推荐    25
部分章节阅读：

2.1 AMD CPU ASIC design engineering笔试题

嗯,今天去参加AMD笔试了,从这里学到了很多,俺今天也注个号,贡献下,废话不多说了,直接贴题,总共10题.

1.写出clkinv 与通常的inv的区别.
2.画出门控时钟单元电路图,并说明其作用.
3.系统工作的最大时钟频率是否由Hold time决定，并说明理由.
4.列出几种cache,并说出pros 和 cons.(大概,没看明白)
5.A,B,C,D都为32位数据,如果A+B的延时为1ns,那么A+B+C+D的延时可能为:
  a 1.2ns   b 1.8ns    c 2ns    d 3ns
6.下面电路是组合电路还是时序电路?并说出电路的功能
module
input[31:0] din1;
input[4:0]  din2;
input       cntd1;
input       sclk;
ouput       dout1;

reg [31:0] a;
reg [31:0] d;

inter j;
always(a)
for(j=0;j<32;j=j+1)
    a[31-j] = din1[j];

wire b[31:0]=cntd1?a:din1;
wire c[31:0]= b>>din2;

always(c)
for(j=0;j<32;j=j+1)
    d[31-j] = c[j];

wire dout1=cntd1?d:c;

endmodule

7.用Verilog HDL/VHDL实现一个FSM,该FSM只需产生一个脉冲.
8.跨时钟域电路该如何处理,如果采用异步FIFO,那么FIFO的最小深度是多少?
9.什么是setup time ,hold time,并画出下面脚本的时序图
a: set_multicycle_path 2 -setup -from chip/A_reg/cp -to chip/B_reg/d
b: set_multicycle_path 2 -setup -from chip/A_reg/cp -to chip/B_reg/d
   set_multicycle_path 1 -hold -from chip/A_reg/cp -to chip/B_reg/d
10.用perl来regexp下面一组数据(大概,没看明白)
4.5 4 3.5 3 2 1 0 -1 -2  -3 -3.5 -4 - 4.5

2.2 AMD笔试题

分软件，硬件两套卷子，都要做

1 software 都是简答题，主要是汇编， 计算机体系结构， amd 和intel的cpu有什么区别，实模式与保护模式。

2 hardware 10道简答题

   1个有缘RC回路的电流方程  us=uc+ dUc/dt *RC ?

   常见的计算机总线有什么

   sram,dram,sdram,ddr都是什么

   串行总线，并行总线哪个更时髦

   设计电路，那个判断圆盘旋转方向的题

   如何用D-type flip flop设计频域电路

   给了一个逻辑表，设计相应的电路